Implementación de un Codificador y Decodificador Reed Solomon (204,188) en una Tarjeta FPGA con el Algoritmo de Euclides Modificado

Autores/as

  • Cristian Oñate Escuela Politécnica Nacional
  • Pablo Lupera Escuela Politécnica Nacional

DOI:

https://doi.org/10.26910/issn.2528-8083vol3issJIEE2018.2018pp35-42p

Palabras clave:

Algoritmo de Euclides modificado, Corrección de errores, Reed Solomon

Resumen

En este artículo se realiza un análisis de la teoría del código Reed-Solomon, para luego describir específicamente la codificación y decodificación del código Reed-Solomon (204, 188) en VHDL. Posterior a eso, se implementó el código descrito en la tarjeta FPGA Virtex 5 XUPV5-LX110T. El diseño del codificador se lo realizó usando su arquitectura genérica, mientras que para el decodificador se usaron como base los algoritmos de Euclides Modificado, Chien y Forney. Finalmente, se verificó su correcto funcionamiento y se determinó la cantidad de recursos utilizados de la tarjeta al implementar el algoritmo estudiado.

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Publicado

2018-12-02
Estadísticas
Resumen 218

Cómo citar

Oñate, C., & Lupera, P. (2018). Implementación de un Codificador y Decodificador Reed Solomon (204,188) en una Tarjeta FPGA con el Algoritmo de Euclides Modificado. Journal of Science and Research, 3(JIEE2018), 35–42. https://doi.org/10.26910/issn.2528-8083vol3issJIEE2018.2018pp35-42p

Número

Vol. 3 Núm. JIEE2018 (2018): Edición Especial

Sección

Artículo de Investigación

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